課程介紹
Verilog HDL硬件描述語言概述
Verilog HDL自頂向下的設計思想
是選擇Verilog還是VHDL
Verilog HDL有什么用處
如何避免競爭和冒險
行為級和RTL級
Verilog模塊的編寫與驗證舉例
ModelSim和Quartus的使用
Verilog模塊的基本構成要素
Verilog HDL有什么用處?
Verilog中reg與wire的不同點
Verilog中阻塞與非阻塞
Verilog中兩種不同的賦值語句
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用戶評論

Porang
好多都卡著 看不了,,,。。。。
2015年06月30日 16:30:17回復|()
chenyy
很好的視頻,學習了
2015年04月09日 14:48:25回復|()

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